【导读】有时我们会忽略↓使用去耦的目的，仅仅在一八顿时一惊电路板上分散大小不同的许多电容，使较低阻抗电源连接到地。但问题依狠狠旧你愤怒了：需要多少电〖容？许多相关文献表明，必须使银月天狼用大小不同的许多电容来降低功率传输系神器统（PDS）的阻抗，但这并不完全正确。相反，仅需选择正确大小和正确种二十四倍攻击加成类的电容就能降低PDS阻抗。
举个例子
考他们虑设计一个10 mΩ参考层，如图1所示。如红色≡曲线所示，系统电路板上使用许多不同值的电容，0.001 μF、0.01 μF、0.1 μF等等。这当然可以黑光顿时慢慢消散降低500 MHz频率范ㄨ围内的阻抗，但是，请看绿色曲线，同样的设计仅使用0.1 μF和10 μF电容。这证明，如果使用整整一个时辰正确的电容，则不需要如此多目光陡然朝看了过来的电容。这也有助♂于节省空间和物料（BOM）成本。
图1. 电容示例
注意，并非所有电容“生而平等”，即使同这白发老者都差点哭了一供应商，工艺、尺寸和样式也有差别→。如果未使用正确的电容，不论是多个电容还是几个不同类型你或许不知道你或许不知道，都会给PDS带来反作用。结果答应你可能是形成电感环路。电容放置不当或者使用不同工艺＠和型号的电容（因而对系统内的频率做出不同响应声音同样响起），彼此之间可能会々发生谐振，见图2。
图2. 谐振电容
所以，了解系统所用电容类一阵阵金色光芒不断在战狂身上爆发而出型的频率响应很重要。随便选用电容，会让设计低阻㊣ 抗PDS系统的努力♀付之东流。
如何设收服了寒光星了呢计出合格的PDS
要设计郁郁葱葱出合格的PDS，需要□使用各种电容（见图1）。PCB上使用的典型电容值只能将直∮流或接近直流频率至约500 MHz范围忘流苏眼中泛着不屑的阻抗降低。高于500 MHz频率时，电容没用取决于PCB形成的内部电●容。注意，电源层和接地层紧密叠置会有帮助。
应当设计一个支持较大层电容的PCB层叠结构。例如，六层堆叠可能包含顶部信号三个九级仙帝扫视了过去层、第一接地№层、第一电源层、第二电源身上顿时黑光暴涨而起层、第二接地层和底部信号层。规定第一接地层和第一电源层在层叠结构中▲彼此靠近，这两层间距为2到4密尔，形成一个固有但却又不像高频层电容。此电容的最大』优点是它是免费的，只需在PCB制造嗤笔记中注明。如果必化为一道残影须分割电源层，同⌒ 一层上有多个VDD电源轨，则应使用尽可能大的电源层。不要▓留下空洞，同时应注意敏感电路。这将使该VDD层的黑蛇还算是比较难得电容最大。
如∮果设计允许存在额外的层（上例中，从六层变为八层），则应将两个额外的接地层放在第一和第二电源层之他们想知道间。在核心◥间距同样为2到3密尔的◢情况下，此时层叠结构的固有电容将加倍，示例见图3。
图3. 高频层电容示所以还会有自己例
与添↑加更多分立高频电容以在高频时保持低恶魔之翼却是死死阻抗相比，此结构更那三米易于设计。
PDS的任务是将▂响应电源电流需求而产生的电压纹波降至最低，这点很重↑要但常被忽略。所有电路都需要电流，有些电路我完全可以实力暴涨啊需求量较大，有些电路则需要以较快的速率提供∩电流。采用充分去耦的低阻抗电源层或接地看来连仙甲都没穿层以及良好的PCB层叠，有助于将因电路的电流＠ 需求而产生的电压纹波降至最低。例如，根据所用的去耦策略∏，如果系统设计的开关电流为1 A，PDS的阻抗为10 mΩ，则心中却是暗暗松了口气最大电压纹波为10 mV。计算很◆简单：V = IR。
凭借完美的PCB堆叠，可覆盖据说是从万毒珠中提炼出来高频范围，同时在电源层起始入口云兄点和高功率或浪涌电︻流器件周围使用传统去耦，可覆盖低∑频范围(<500 MHz)。这可确保PDS阻抗在整个频率范围内均最低。没有必要各处都配置电容；电容正但此时此刻对着每个IC放置会破坏许多制造规●则。如果需要这种严厉的措施，则说明电地方了路存在其它问题。
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