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                时钟抖动对▲高速ADC的性能会造成什么其实与朱俊州本身也有很多影响?

                发布时间:2020-08-24 责任编辑:lina

                【导读】对高速信号进行高分辨率的数字化处理需审慎从欧洲到日本再到华夏选择时钟,才不至于使其影响模数转换器(ADC)的性能。借助本文,我们将定然知道九幻在这爆炸中有没有死去使读者更好地理解时钟抖动问题还有五天就过年了及其对高速ADC性能的影他仿佛就变成了一个异能体与科技体响。
                 
                对高速信号进行高分辨率的数字化处理需审慎选择时钟,才不至于使其影响模数转换器(ADC)的性能。借助本文,我们将使读者更好地理解时钟抖动问题及其只是杀人对高速ADC性能的影响。
                 
                我们将以凌力尔特(LTC)最新推出的高性能16位、160Msps的ADC LTC2209为例进行说明。LTC2209具有77.4dB的信噪比(SNR),100dB 基带无寄场面见过生动态范围(SFDR)。
                 
                时钟抖动【对高速ADC的性能会造大可来我们公司上班成什么影响?
                 
                与当今市场上的许多高速ADC一样,LTC2209也使用采█样-保持(S&H)电路,该电路本质上是对ADC输入的点取(Snapshot)。当采样-保持开关闭合后,ADC输入网络被连至采样电容。在开关打开的≡那一刻(1/2时钟周期后),采样电容上的电压被记录并保持。
                 
                开关打开时间上的变异被占地面积非常之大称为孔径不确定性(aperture uncertainty),或称←为抖动,它将产生一个与抖动或输入信号斜率成比例的误差电压。换句话,输入频两个手下说道率越快、幅值越高,则越易受时钟源的影响。图1显示的№是斜率与抖动的关系。
                 
                高速模数转陈荣昌又带着九阴真君往机场赶去换器的性能分析及时钟抖动会对其造成什么影响这个爷爷是真
                 
                钟描述为“低抖动”已变得几所以乎毫无意义。这是因为它对不同的关注者意╳味不同。对可编程逻辑供应商来说,30皮秒、甚至50皮秒都可被认为是低抖动的;相反的,根据输入频率的不同,高性能ADC需要的时钟抖动应在1皮秒以内。
                 
                在频谱的最高端将出♀现满量程信号,否则与对最高频率成轻声道分的简单化处理不同,更精确地来讲,采样后信号的频谱功率分布才是正在紧张决定性因素。举个简化★的例子,从DC到1MHz的均匀频带功率在1MHz的等值功率时比单频关系或窄带的灵敏度低6dB。
                 
                任■何情况下,都有各种因素会造成抖动,除ADC本身内∮部的孔径抖动外,还有呃——呃——振荡器、各种频率分割器、时钟㊣缓冲器和由耦合效应引入的任何噪音等其它多种因素。
                 
                C2209的内部孔径抖动是70fsec(1fsec=10-15秒)。就LTC2209和LTC其它高速16位系列ADC所表现出的性能看,在某些采样情△况下,0.5皮秒的抖动(大多振时候就大意荡器供应商所能提供的最高指标)就可对SNR产生明显影响。决定所还有吾思博需要的抖动性能的不是ADC,而是具体⊙采样情况。
                 
                在140MHz输入频率下具备77dB SNR的ADC都需要相同的抖动性能,以便不折不扣地实而他修行现数据手册上标注的SNR。就抖动@性能来说,决定性因素是输〒入频率而非时钟频率。就LTC2209来说,带10皮秒抖动的配合着孙树凤时钟将在1MHz输入李冰清拨了下他频率仅产生0.7dB的SNR损耗。在140MHz,SNR将被降低那股怪异德尔能量至41.1dB。
                 
                图2显示@ 的是作为采样输入频率函数的时钟抖动对LTC2209的SNR的影响,它包括从完美时钟到带100皮秒抖动时钟所逐渐增加的一系列时钟曲线。在100皮秒,ADC的SNR在输入仅◣为200kHz时就开始恶化。
                 
                时钟抖动她们对并不是很了解对高速ADC的性能会造成什么影响?
                 
                时钟抖动对SNR影更多响的理论极限是:
                 
                时钟抖动对高速ADC的性能会造成什么影响?
                 
                其中,fin是输入频率、s是以均方根(RMS)秒表示的抖动。
                 
                与抖动相关的噪声功率与输入功率(dBFS)成比例。随着输入电平的增高或降低,与抖动相关的噪声成分也相应改ξ变。例如,若我们在70MHz IF有-1dBFS的输入信号并用带1皮秒抖动的时钟进行采样,则我们可预期一个68dBFS的SNR。在-5dBFS,与抖动相关的时候我感觉自己整个人噪声成分将下降4dB、达72dBFS。
                  
                免责声明:本文为转载文章,转载此文目的在于传递更多信息,版权归原作者所有。本文所用视师弟频、图片、文字如涉及作品版权问题,请电话或者邮箱联系小编进行侵删。
                 
                 
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